A 40-44 Gb/s 3 × oversampling CMOS CDR/1:16 DEMUX

Nikola Nedovic, Nestoras Tzartzanis, Hirotaka Tamura, Francis M. Rotella, Magnus Wiklund, Yuma Mizutani, Yusuke Okaniwa, Tadahiro Kuroda, Junji Ogawa, William W. Walker

研究成果: Article査読

20 被引用数 (Scopus)

抄録

A CMOS CDR and 1:16 demux fabricated in a low-cost 90 nm bulk CMOS process operates at 40-44 Gb/s and dissipates 910 mW. A quarter-rate hybrid phase-tracking/3 × blind-oversampling architecture is used to improve jitter tolerance, reduce the need for high-power CML circuits, and enable frequency acquisition without a reference clock. Input data are sampled using a 24-phase distributed VCO, and a digital CDR recovers 16 bits and a 2.5 GHz clock from 48 demultiplexed samples spanning 16 UI. Conformance to the ITU-T G.8251 jitter tolerance mask (BER < 10-12 with a 231-1 PRBS source) is demonstrated using both an on-chip and an external BERT.

本文言語English
論文番号4381457
ページ(範囲)2726-2735
ページ数10
ジャーナルIEEE Journal of Solid-State Circuits
42
12
DOI
出版ステータスPublished - 2007 12月
外部発表はい

ASJC Scopus subject areas

  • 電子工学および電気工学

フィンガープリント

「A 40-44 Gb/s 3 × oversampling CMOS CDR/1:16 DEMUX」の研究トピックを掘り下げます。これらがまとまってユニークなフィンガープリントを構成します。

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